Analysis of Mixed PUF-TRNG Circuit Based on SR-Latches in FD-SOI Technology - Télécom Paris
Communication Dans Un Congrès Année : 2018

Analysis of Mixed PUF-TRNG Circuit Based on SR-Latches in FD-SOI Technology

Domaines

Architectures Matérielles [cs.AR] Arithmétique des ordinateurs Cryptographie et sécurité [cs.CR] Bibliothèque électronique [cs.DL] Modélisation et simulation Electronique

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https://telecom-paris.hal.science/hal-02271687

Soumis le : mardi 27 août 2019-10:33:21

Dernière modification le : mercredi 23 octobre 2024-10:30:04

Fichier non déposé

Dates et versions

hal-02271687 , version 1 (27-08-2019)

Identifiants

  • HAL Id : hal-02271687 , version 1

Citer

Jean-Luc Danger, Risa Yashiro, Tarik Graba, Yves Mathieu, Abdelmalek Si-Merabet, et al.. Analysis of Mixed PUF-TRNG Circuit Based on SR-Latches in FD-SOI Technology. 2018 21st Euromicro Conference on Digital System Design (DSD), Aug 2018, Prague, Czech Republic. pp.508-515. ⟨hal-02271687⟩

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